Dieses Buch versucht, eine durchgängige Systematik des Hardwareent wurfs über verschiedene Abstraktionsebenen hinweg darzustellen. Da bei wird von einem abstrakten Modell des Entwurfsvorgangs als über mehrere Abstraktionsebenen reichender rückgekoppelter Prozeß aus gegangen. Auf der Basis dieses Modells werden verschiedene Klas sen von Entwurfsaktivitäten identifiziert. Es sind dies: Modellierung, Modifikation/Optimierung, Implementation und Verifikation. Die ver schiedenen Abstraktionsebenen (Systemebene, algorithmische Ebene, Registertransfer-Ebene, Gatterebene, Schalterebene/ Ebene des sym bolischen Layouts, elektrische/Layout-Ebene) werden in verschiedenen Sichten (Verhalten, Struktur, Geometrie, Test) charakterisiert. Dient das erste Kapitel dazu, eine allgemeine Systematik des Hardwareent wurfs zu entwickeln, so werden in den weiteren Kapiteln verschiedene Entwurfsaktivitäten beispielhaft diskutiert. Das Kapitel 2 ist den verschiedene Methoden der Hardwaremodellie rung gewidmet. Nach einem allgemeinen Überblick wird darin exempla risch die Breitband-Hardwarebeschreibungssprache DACAPO detail lierter eingeführt. Dies erlaubt, über verschiedene Aspekte des Hard wareentwurfs in einheitlicher Terminologie zu sprechen, und zwar nicht nur über Hardwarebeschreibungen auf unterschiedlichen Abstraktions ebenen, sondern auch über verschiedene Algorithmen des Entwurfs prozesses. Im Kapitel 3 (Implementierungsaktivitäten) wird mit besonderem Au genmerk der Ubergang von der algorithmischen auf die Registertrans ferebene behandelt. Aber auch verschiedene Methoden des Steuerwerks entwurfs und der Übergang auf die Gatterebene finden Berücksichti gung. Ein ausführliches Entwurfsbeispiel soll zur Illustration dienen. Optimierungsverfahren (Kapitel 4) werden hauptsächlich auf der Regi stertransferebene, aber auch auf der algorithmischen und Gatterebene diskutiert. Auch hier wird ein Beispiel exemplarisch durchgeführt. Das Kapitel 5 ist der Verifikation/Evaluation/Validierung gewidmet.
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Paperback. Condition: new. Paperback. Dieses Buch versucht, eine durchgaengige Systematik des Hardwareent- wurfs ueber verschiedene Abstraktionsebenen hinweg darzustellen. Da- bei wird von einem abstrakten Modell des Entwurfsvorgangs als ueber mehrere Abstraktionsebenen reichender rueckgekoppelter Prozess aus- gegangen. Auf der Basis dieses Modells werden verschiedene Klas- sen von Entwurfsaktivitaeten identifiziert. Es sind dies: Modellierung, Modifikation/Optimierung, Implementation und Verifikation. Die ver- schiedenen Abstraktionsebenen (Systemebene, algorithmische Ebene, Registertransfer-Ebene, Gatterebene, Schalterebene/ Ebene des sym- bolischen Layouts, elektrische/Layout-Ebene) werden in verschiedenen Sichten (Verhalten, Struktur, Geometrie, Test) charakterisiert. Dient das erste Kapitel dazu, eine allgemeine Systematik des Hardwareent- wurfs zu entwickeln, so werden in den weiteren Kapiteln verschiedene Entwurfsaktivitaeten beispielhaft diskutiert. Das Kapitel 2 ist den verschiedene Methoden der Hardwaremodellie- rung gewidmet. Nach einem allgemeinen UEberblick wird darin exempla- risch die Breitband-Hardwarebeschreibungssprache DACAPO detail- lierter eingefuehrt. Dies erlaubt, ueber verschiedene Aspekte des Hard- wareentwurfs in einheitlicher Terminologie zu sprechen, und zwar nicht nur ueber Hardwarebeschreibungen auf unterschiedlichen Abstraktions- ebenen, sondern auch ueber verschiedene Algorithmen des Entwurfs- prozesses. Im Kapitel 3 (Implementierungsaktivitaeten) wird mit besonderem Au- genmerk der Ubergang von der algorithmischen auf die Registertrans- ferebene behandelt. Aber auch verschiedene Methoden des Steuerwerks- entwurfs und der UEbergang auf die Gatterebene finden Beruecksichti- gung. Ein ausfuehrliches Entwurfsbeispiel soll zur Illustration dienen. Optimierungsverfahren (Kapitel 4) werden hauptsaechlich auf der Regi- stertransferebene, aber auch auf der algorithmischen und Gatterebene diskutiert. Auch hier wird ein Beispiel exemplarisch durchgefuehrt. Das Kapitel 5 ist der Verifikation/Evaluation/Validierung gewidmet. Von der System bis zur GatterEbene. Shipping may be from multiple locations in the US or from the UK, depending on stock availability. Seller Inventory # 9783519022657
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Taschenbuch. Condition: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -Dieses Buch versucht, eine durchgängige Systematik des Hardwareent wurfs über verschiedene Abstraktionsebenen hinweg darzustellen. Da bei wird von einem abstrakten Modell des Entwurfsvorgangs als über mehrere Abstraktionsebenen reichender rückgekoppelter Prozeß aus gegangen. Auf der Basis dieses Modells werden verschiedene Klas sen von Entwurfsaktivitäten identifiziert. Es sind dies: Modellierung, Modifikation/Optimierung, Implementation und Verifikation. Die ver schiedenen Abstraktionsebenen (Systemebene, algorithmische Ebene, Registertransfer-Ebene, Gatterebene, Schalterebene/ Ebene des sym bolischen Layouts, elektrische/Layout-Ebene) werden in verschiedenen Sichten (Verhalten, Struktur, Geometrie, Test) charakterisiert. Dient das erste Kapitel dazu, eine allgemeine Systematik des Hardwareent wurfs zu entwickeln, so werden in den weiteren Kapiteln verschiedene Entwurfsaktivitäten beispielhaft diskutiert. Das Kapitel 2 ist den verschiedene Methoden der Hardwaremodellie rung gewidmet. Nach einem allgemeinen Überblick wird darin exempla risch die Breitband-Hardwarebeschreibungssprache DACAPO detail lierter eingeführt. Dies erlaubt, über verschiedene Aspekte des Hard wareentwurfs in einheitlicher Terminologie zu sprechen, und zwar nicht nur über Hardwarebeschreibungen auf unterschiedlichen Abstraktions ebenen, sondern auch über verschiedene Algorithmen des Entwurfs prozesses. Im Kapitel 3 (Implementierungsaktivitäten) wird mit besonderem Au genmerk der Ubergang von der algorithmischen auf die Registertrans ferebene behandelt. Aber auch verschiedene Methoden des Steuerwerks entwurfs und der Übergang auf die Gatterebene finden Berücksichti gung. Ein ausführliches Entwurfsbeispiel soll zur Illustration dienen. Optimierungsverfahren (Kapitel 4) werden hauptsächlich auf der Regi stertransferebene, aber auch auf der algorithmischen und Gatterebene diskutiert. Auch hier wird ein Beispiel exemplarisch durchgeführt. Das Kapitel 5 ist der Verifikation/Evaluation/Validierung gewidmet. 357 pp. Deutsch. Seller Inventory # 9783519022657
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