Items related to Conception numérique de SDRAM sur Verilog
Synopsis
Concevoir une mémoire dynamique synchrone à accès aléatoire (SDRAM) de 8 MB x 16 x 4-BAnk (512 MB) en utilisant le langage de description du matériel Verilog, qui peut être utilisé dans n'importe quelle application basée sur la mémoire. Aujourd'hui, les ordinateurs, ainsi que d'autres systèmes électroniques qui nécessitent de grandes quantités de mémoire, utilisent des DRAM pour la mémoire de base. En raison de la structure unique des cellules de transistor de la DRAM, des réseaux de mémoire extrêmement denses peuvent être construits dans un seul dispositif occupant un encombrement relativement faible. La DRAM conventionnelle est contrôlée de manière asynchrone, ce qui oblige le concepteur du système à insérer manuellement les états de veille pour répondre aux spécifications du dispositif. La synchronisation dépend de la vitesse de la DRAM et est indépendante de la vitesse du bus système. Cesont ces limitations de la synchronisation qui ont conduit au développement de la SDRAM. La SDRAM est en grande partie une DRAM rapide avec une interface synchrone à grande vitesse. Les signaux d'entrée/sortie et de contrôleur sont synchronisés avec une horloge externe, ce qui offre de nouvelles options au concepteur. Des circuits d'interface simplifiés et un débit de données élevé peuvent être obtenus en utilisant la SDRAM par rapport à la DRAM conventionnelle.
"synopsis" may belong to another edition of this title.
Buy New
View this item
£ 35.53
£ 9.51 shipping from Germany to United Kingdom
Destination, rates & speedsSearch results for Conception numérique de SDRAM sur Verilog
Seller Image
Conception numérique de SDRAM sur Verilog
Published by
Editions Notre Savoir Okt 2022, 2022
ISBN 10: 6205313812
ISBN 13: 9786205313817
New
Taschenbuch
Seller: BuchWeltWeit Ludwig Meier e.K., Bergisch Gladbach, Germany
Seller rating 5 out of 5 stars
Taschenbuch. Condition: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -Concevoir une mémoire dynamique synchrone à accès aléatoire (SDRAM) de 8 MB x 16 x 4-BAnk (512 MB) en utilisant le langage de description du matériel Verilog, qui peut être utilisé dans n'importe quelle application basée sur la mémoire. Aujourd'hui, les ordinateurs, ainsi que d'autres systèmes électroniques qui nécessitent de grandes quantités de mémoire, utilisent des DRAM pour la mémoire de base. En raison de la structure unique des cellules de transistor de la DRAM, des réseaux de mémoire extrêmement denses peuvent être construits dans un seul dispositif occupant un encombrement relativement faible. La DRAM conventionnelle est contrôlée de manière asynchrone, ce qui oblige le concepteur du système à insérer manuellement les états de veille pour répondre aux spécifications du dispositif. La synchronisation dépend de la vitesse de la DRAM et est indépendante de la vitesse du bus système. Cesont ces limitations de la synchronisation qui ont conduit au développement de la SDRAM. La SDRAM est en grande partie une DRAM rapide avec une interface synchrone à grande vitesse. Les signaux d'entrée/sortie et de contrôleur sont synchronisés avec une horloge externe, ce qui offre de nouvelles options au concepteur. Des circuits d'interface simplifiés et un débit de données élevé peuvent être obtenus en utilisant la SDRAM par rapport à la DRAM conventionnelle. 52 pp. Französisch. Seller Inventory # 9786205313817
Quantity: 2 available
Seller Image
Conception numérique de SDRAM sur Verilog
Print on DemandSeller: AHA-BUCH GmbH, Einbeck, Germany
Seller rating 5 out of 5 stars
Taschenbuch. Condition: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Concevoir une mémoire dynamique synchrone à accès aléatoire (SDRAM) de 8 MB x 16 x 4-BAnk (512 MB) en utilisant le langage de description du matériel Verilog, qui peut être utilisé dans n'importe quelle application basée sur la mémoire. Aujourd'hui, les ordinateurs, ainsi que d'autres systèmes électroniques qui nécessitent de grandes quantités de mémoire, utilisent des DRAM pour la mémoire de base. En raison de la structure unique des cellules de transistor de la DRAM, des réseaux de mémoire extrêmement denses peuvent être construits dans un seul dispositif occupant un encombrement relativement faible. La DRAM conventionnelle est contrôlée de manière asynchrone, ce qui oblige le concepteur du système à insérer manuellement les états de veille pour répondre aux spécifications du dispositif. La synchronisation dépend de la vitesse de la DRAM et est indépendante de la vitesse du bus système. Cesont ces limitations de la synchronisation qui ont conduit au développement de la SDRAM. La SDRAM est en grande partie une DRAM rapide avec une interface synchrone à grande vitesse. Les signaux d'entrée/sortie et de contrôleur sont synchronisés avec une horloge externe, ce qui offre de nouvelles options au concepteur. Des circuits d'interface simplifiés et un débit de données élevé peuvent être obtenus en utilisant la SDRAM par rapport à la DRAM conventionnelle. Seller Inventory # 9786205313817
Quantity: 1 available
Seller Image
Conception numérique de SDRAM sur Verilog
Seller: moluna, Greven, Germany
Seller rating 5 out of 5 stars
Condition: New. Seller Inventory # 749296816
Quantity: Over 20 available
Seller Image
Conception numérique de SDRAM sur Verilog
Published by
Editions Notre Savoir Okt 2022, 2022
ISBN 10: 6205313812
ISBN 13: 9786205313817
New
Taschenbuch
Seller: buchversandmimpf2000, Emtmannsberg, BAYE, Germany
Seller rating 5 out of 5 stars
Taschenbuch. Condition: Neu. Neuware -Concevoir une mémoire dynamique synchrone à accès aléatoire (SDRAM) de 8 MB x 16 x 4-BAnk (512 MB) en utilisant le langage de description du matériel Verilog, qui peut être utilisé dans n'importe quelle application basée sur la mémoire. Aujourd'hui, les ordinateurs, ainsi que d'autres systèmes électroniques qui nécessitent de grandes quantités de mémoire, utilisent des DRAM pour la mémoire de base. En raison de la structure unique des cellules de transistor de la DRAM, des réseaux de mémoire extrêmement denses peuvent être construits dans un seul dispositif occupant un encombrement relativement faible. La DRAM conventionnelle est contrôlée de manière asynchrone, ce qui oblige le concepteur du système à insérer manuellement les états de veille pour répondre aux spécifications du dispositif. La synchronisation dépend de la vitesse de la DRAM et est indépendante de la vitesse du bus système. Cesont ces limitations de la synchronisation qui ont conduit au développement de la SDRAM. La SDRAM est en grande partie une DRAM rapide avec une interface synchrone à grande vitesse. Les signaux d'entrée/sortie et de contrôleur sont synchronisés avec une horloge externe, ce qui offre de nouvelles options au concepteur. Des circuits d'interface simplifiés et un débit de données élevé peuvent être obtenus en utilisant la SDRAM par rapport à la DRAM conventionnelle.Books on Demand GmbH, Überseering 33, 22297 Hamburg 52 pp. Französisch. Seller Inventory # 9786205313817
Quantity: 2 available